由于目前大部分的数字电路中，要求时序控制时间已达到 psec 的范围。因此，在这些系统中，各种组件相互链接的导体不应再只被看作是一根简单的导线，而应将视之为呈现了高频效应的传输线。如果这些传输线没有经过合理的设计，而仍然以低频的角度来看待这些传输线，那么
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高速数字电路设计之串音分析
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板级设计
原文: 高速数字电路设计之串音分析
由于目前大部分的数字电路中，要求时序控制时间已达到 psec 的范围。因此，在这些系统中，各种组件相互链接的导体不应再只被看作是一根简单的导线，而应将视之为呈现了高频效应的传输线。如果这些传输线没有经过合理的设计，而仍然以低频的角度来看待这些传输线，那么
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